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      <title>Arquitecturas by </title>
      <link>https://padlet.com/ejgomez4/c7u52i4rgjvjr9r3</link>
      <description>MIPS, x86, ARM, PA-RISC</description>
      <language>en-us</language>
      <pubDate>2020-11-05 21:12:02 UTC</pubDate>
      <lastBuildDate>2024-05-30 20:27:13 UTC</lastBuildDate>
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         <title>MIPS</title>
         <author>mnmawyin</author>
         <link>https://padlet.com/ejgomez4/c7u52i4rgjvjr9r3/wish/895952532</link>
         <description><![CDATA[<ul><li>MIPS I tiene 32 registros de propósito general (GPR) de 32 bits.</li><li>Cuenta también con 32 registros 64 bits para aritmética flotante (FPRs)</li><li>Tiene varias extensiones opcionales</li><li>Se utilizan en sistemas integrados</li><li>Fue diseñado originalmente para computación de propósito general.</li><li>Arquitectura tipo load‐store sencilla de 64 bits </li><li>Memoria direccionable por bytes con dirección de 64 bits: Las palabras en memoria están alineadas </li></ul>]]></description>
         <pubDate>2020-11-05 21:19:04 UTC</pubDate>
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      </item>
      <item>
         <title>x86</title>
         <author>mnmawyin</author>
         <link>https://padlet.com/ejgomez4/c7u52i4rgjvjr9r3/wish/895952889</link>
         <description><![CDATA[<ul><li>Creada por INTEL</li><li>La "<strong>x</strong>" en x86 indica la versión ISA.</li><li><strong>No limpia:</strong> Compatibilidad con los procesadores 16 bits de INTEL</li><li>Longitud de instrucción variable</li><li>Todos los registros tienen un tamaño de 32 bits</li><li>Arquitectura muy potente</li><li>Consumen más energía que los modelos ARM</li><li>Los formatos de instrucción son muy irregulares</li><li>Instrucciones de tamaño variable: 1-14 bits</li><li>Precios bajos</li></ul><div>Características clave:</div><ul><li>Marco lógico para ejecutar instrucciones a través de un procesador.</li><li>Los programas de software y las instrucciones se ejecutan en cualquier procesador de la familia INTEL 8086</li><li>Procedimientos para utilizar y administrar los componentes de hardware de un CPU.</li></ul><div>Registros en la arquitectura:</div>]]></description>
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         <pubDate>2020-11-05 21:19:12 UTC</pubDate>
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      </item>
      <item>
         <title>Referencias </title>
         <author>ejgomez4</author>
         <link>https://padlet.com/ejgomez4/c7u52i4rgjvjr9r3/wish/896039138</link>
         <description><![CDATA[<div>ARM:</div><ul><li>Cidecame. (2020). . <em>1.8 Arquitectura ARM</em>. Retrieved from: Cidecame http://cidecame.uaeh.edu.mx/lcc/mapa/PROYECTO/libro20/18_arquitectura_arm.html</li><li>Gomar, J. (2018). <em>Qué Es Un Procesador ARM Y Como Funciona ?</em>. Retrieved from: Profesional Review https://www.profesionalreview.com/2018/12/05/que-es-procesador-arm-como-funciona/</li></ul><div>PA-RISC: </div><ul><li>Camacho, S. (1993, Febrero 26). <em>PA-RISC: tecnología y estrategia.</em> Retrieved from COMPUTERWORLD: https://www.computerworld.es/archive/parisc-tecnologia-y-estrategia</li></ul><div>x86:</div><ul><li>Espeso, P. (2013, Enero 23) Retrieved from Xataka: https://www.xataka.com/componentes/arquitectura-x86-una-historia-imprescindible-de-la-informatica</li><li>Loloya Marymount University (N/A) Retrieved from LMU: https://cs.lmu.edu/~ray/notes/x86overview/</li></ul><div>MIPS:</div><ul><li>Guaza, E. (N/A) Retrieved from Universidad de Valladolid: https://www.infor.uva.es/~bastida/OC/Formatos8086.pdf</li></ul>]]></description>
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         <pubDate>2020-11-05 21:52:23 UTC</pubDate>
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      </item>
      <item>
         <title>Registros</title>
         <author>ejgomez4</author>
         <link>https://padlet.com/ejgomez4/c7u52i4rgjvjr9r3/wish/899565816</link>
         <description><![CDATA[<ul><li><strong>MIPS:</strong> tamaño de 64 bits con operaciones de 64 bits. Soporta operaciones de arimética flotante </li><li><strong>x86:</strong> tamaño de 32 bits con instrucciones de tamaño variable (1-14 bits)</li><li><strong>ARM: </strong>tamaño de 32 y 64 bits con operaciones de 16 bits</li><li><strong>PA-RISC:</strong> tamaño de 32 y 64 bits con operaciones de 32 bits. Soporta operaciones de arimética flotante </li></ul><div><br></div>]]></description>
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         <pubDate>2020-11-07 02:20:20 UTC</pubDate>
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      </item>
      <item>
         <title>Consumo de energía</title>
         <author>ejgomez4</author>
         <link>https://padlet.com/ejgomez4/c7u52i4rgjvjr9r3/wish/899570065</link>
         <description><![CDATA[<ul><li><strong>MIPS:</strong>  medio-bajo</li><li><strong>x86:</strong> alto</li><li><strong>ARM: </strong>bajo</li><li><strong>PA-RISC: </strong>medio-alto (depende del dispositivo)</li></ul><div><br></div>]]></description>
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         <pubDate>2020-11-07 02:25:31 UTC</pubDate>
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      <item>
         <title>Tipo de arquitectura</title>
         <author>ejgomez4</author>
         <link>https://padlet.com/ejgomez4/c7u52i4rgjvjr9r3/wish/899572443</link>
         <description><![CDATA[<ul><li><strong>MIPS:</strong>  RISC (Reduced Instruction Set Comptuter)</li><li><strong>x86:</strong> CISC (Complex Instruction Set Computer)</li><li><strong>ARM: </strong>RISC</li><li><strong>PA-RISC: </strong>RISC</li></ul><div><br></div>]]></description>
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         <pubDate>2020-11-07 02:28:41 UTC</pubDate>
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      <item>
         <title>Uso principal</title>
         <author>ejgomez4</author>
         <link>https://padlet.com/ejgomez4/c7u52i4rgjvjr9r3/wish/899574018</link>
         <description><![CDATA[<ul><li><strong>MIPS:</strong>  De propósito general aunque es ampliamente utilizado en sistemas integrados</li><li><strong>x86:</strong> Principalmente en hardwares de CPUs</li><li><strong>ARM: </strong>Aplicaciones móviles</li><li><strong>PA-RISC: </strong>Dispositivos de marca HP aunque también son utilizados en otros sistemas operativos</li></ul><div><br></div>]]></description>
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         <pubDate>2020-11-07 02:30:41 UTC</pubDate>
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      <item>
         <title>Implementación de arquitecturas</title>
         <author>ejgomez4</author>
         <link>https://padlet.com/ejgomez4/c7u52i4rgjvjr9r3/wish/899579538</link>
         <description><![CDATA[<ul><li><strong>MIPS:</strong>  Sistemas embebidos, routers Cisco, consolas como Nintendo, Playstation</li><li><strong>x86:</strong> Dispositivos de marca INTEL</li><li><strong>ARM: </strong>Distribuciones de LINUX como: Android, Chrome OS, Ubuntu, etc.</li><li><strong>PA-RISC: </strong>Dispositivos de marca HP</li></ul><div><br></div>]]></description>
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         <pubDate>2020-11-07 02:37:46 UTC</pubDate>
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      </item>
      <item>
         <title>Conjunto de instrucciones</title>
         <author>ejgomez4</author>
         <link>https://padlet.com/ejgomez4/c7u52i4rgjvjr9r3/wish/899582990</link>
         <description><![CDATA[<ul><li><strong>MIPS:</strong>  Las instrucciones se dividen en tres tipos: R, I y J.</li><li><strong>x86:</strong> Instrucciones de tamaño variable: 1-14 bits con formatos de irregulares</li><li><strong>ARM: </strong>Operaciones de 16 bits en las cuales los 4 primeros bits son utilizados como condicionales</li><li><strong>PA-RISC: </strong>Operaciones con 32 bits de un sólo ciclo</li></ul><div><br></div>]]></description>
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         <pubDate>2020-11-07 02:42:16 UTC</pubDate>
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      </item>
      <item>
         <title>Otras características</title>
         <author>ejgomez4</author>
         <link>https://padlet.com/ejgomez4/c7u52i4rgjvjr9r3/wish/899584317</link>
         <description><![CDATA[<ul><li><strong>MIPS:</strong>  Memoria direccionable por bytes con dirección de 64 bits: Las palabras en memoria están alineadas </li><li><strong>x86:</strong> Marco lógico para ejecutar instrucciones a través de un procesador.</li><li><strong>ARM: </strong>Conjunto de instrucciones reducido debido al bajo consumo de energía </li><li><strong>PA-RISC: </strong>Permite ejecución simultanea entre una operación con enteros y numeros flotantes, aunque en la actualidad ya esta descontinuado</li></ul><div><br></div>]]></description>
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         <pubDate>2020-11-07 02:43:52 UTC</pubDate>
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