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＃11165　　留言者:庚子　　[2013-05-26 23:42:06]

主題：非同步ＦＰＧＡ芯片
之前在尋找有闗ＦＰＧＡ的資料時，找到一個新聞，給老師參考。
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Achronix：另辟蹊徑鑄造成功
作者： 叢秋波 EDN China副主編 上網日期： 2008年12月01日
http://www.ednchina.com/ART_52112_18_0_OA_8c118383.HTM
Xilinx、Altera都是非常了不起的公司，他們的成功經驗很值得我們學習。Achronix要想獲得成功，就不能與現有的FPGA廠商競爭，而是把目標市場放在更高性能需求的FPGA領域。
在FPGA領域，Achronix是新一代。如何突破FPGA重圍的藍海之道，在市場上獲得勝出的機會？Achronix公司創始人、董事長兼首席執行官John Holt是這樣認為的：關鍵是找到自己“最適合做什麼”，這比一味“做大”更重要。“差異化戰略”是獲得成功的法寶。
尋找突破口 攻克技術難關
FPGA 市場是一個很難進入的市場，只有推出真正具有創新性的產品，才有可能在此市場領域競爭並取得勝利。John Holt說，Xilinx、Altera都是非常了不起的公司，他們的成功經驗很值得我們學習。Achronix要想獲得成功，就不能與現有的FPGA廠商競爭，而是把目標市場放在更高性能需求的FPGA領域。
Achronix公司成立於4年前，在開發FPGA產品方面重點突出什麼特點上，公司首先對200多家公司進行了調研，針對電信行業，客戶們對產品的速度、功耗、成本、密度和I/O等方面都有要求的情況下，尤其對速度提出更高的求，找到了突破口，又從根本上解決了為實現高靈活性與加速產品上市進程而不得不犧牲性能的重要技術難題。Achronix推出了Speedster 系列的首款產品－－ SPD60，該產品系列的速度可達 1.5 GHz，性能比現有 FPGA 提高了 3 倍。
John Holt在接受《EDN China》記者采訪時表示，許多初創的FPGA廠商失敗的原因主要歸納以下幾個方面，一是沒有資金；二是研發的不是大眾接受的產品；三是開發工具大家都不熟悉。Achronix首先就避免這些錯誤，拿到了這個行業的最大投資3440萬美元，研發的第一款產品就實現了FPGA性能的突破，由於Achronix產品的架構和傳統的FPGA一樣， Achronix 與領先的合成技術廠商合作推出了與 Speedster 系列兼容的業界標准工具與技術方案。設計人員可充分利用現有的 Verilog 與 VHDL 設計方案。Achronix CAD 環境可支持Synopsys的 Synplify Pro 以及 Mentor Graphics 的 Precision Synthesis 工具，以滿足 RTL 綜合需求。此外，Achronix CAD 環境還針對物理實施、性能優化、定時分析、仿真、調試以及器件編程提供了必需工具。“正是由於Achronix找到自己‘最適合做什麼’，尋找到了突破口，攻克了技術難關，因此，我們成功了。”John Holt說。
采用異步技術突破性能瓶頸
Achronix 認為，FPGA和Cell ASIC目前都達到了性能的瓶頸，這是因為同步邏輯的進一步發展遇到了速度上的障礙。Achronix推出的SPD60產品采用了異步技術，克服了上面所說的技術瓶頸，他的最大特點，一是消除了全局時鐘分布限制；二是自動支持設計管道（picoPIPE），而且這一創新技術可應用於各類邏輯產品。
John Holt說，傳統的FPGA，全局時鐘邏輯不平衡，時鐘速率必須支持整個時鐘域的最慢路徑，任何速度快於最慢路徑的組合邏輯（從定義上說即所有剩余邏輯）都要等待最慢路徑完成。設計人員已經不得不接受 FPGA 每代產品性能只能逐漸慢慢改進的事實，而我們的產品帶來了性能上的飛躍，Achronix技術可實現精細粒度的picoPIPE技術，可支持速度高得多的數據速率，同時picoPIPE還支持傳輸更多數據值，能帶來更快的吞吐速度。
這是因為，Achronix獲得專利的picoPIPE加速技術可以加快數據在FPGA架構中傳輸的速度，在沒有全局時鐘的情況下，picoPIPE采用簡單的握手協議就能有效地控制數據流，從而顯著提升性能，同時還可以使用標准的RTL用於入門級設計並采用常用的FPGA工具。這種創新型技術與 10.3 Gbps 串行器／解串器 (SerDes) 完美結合，有助於提高系統吞吐量，而且還可配合集成 DDR2/DDR3 控制器支持高速存儲器接口，因此 Speedster 產品系列的 I/O 速度能夠完全與其出色的內核性能相匹配。該產品采用 TSMC 的高性能 65 納米G　CMOS 工藝制造。
John Holt表示，有了Speedster FPGA，設計人員就不必再犧牲產品的性能，以換取FPGA的靈活性和高速率。在這個新平台上，設計人員既可執行最高性能的設計，又可避免高昂的ASIC成本和其他FPGA的時序收斂問題。Speedster FPGA完全可重復編程，同時可實現1.5GHz的系統性能。Speedster FPGA系統適合於電信、網絡、視頻、數字信號處理、高性能計算、成像以及工業和軍事等應用。

回應﹕
謝謝，這則新聞來得很及時，時正在考慮購買開發系統，尚未定案，此訊息頗值參考。只是在理論上，若真「消除了全局時鐘分布限制」、「異步邏輯」，其運行速度必能增進Ｎ倍以上（不止三倍）。
在老朽的預估中，運行的速度端視各閘門開、閉的間隔而定，一個「語音辨識模組（採仿真式、以三組邏輯閘分別代表耳中音量、音頻、音相的纖毛）」，因係非同步，可分別得到三組參數。所需的時間，音相較多，要經過２０個閘門，就算每閘耗時５納秒，也不過１００納秒。
不論如何，有了Speedster 後，果如其言，市場就不致受到傳統大廠壟斷，本室也不致處處招人白眼了。總之，Speedster FPGA很接近老朽之理想，當設法進一步瞭解之。

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Altera专区，按主芯片型号、参考价格、接口、应用领域、IDH分类，全面展示开发板和系统板

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